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ISL97686
Pin Configurations
ISL97686
(28 LD 5x5 TQFN)
TOP VIEW
ISL97686
(28 LD SOIC)
TOP VIEW
CH2
1
28 CH3
SDO 1
28
27
26
25
24
23
22
21 NC
CH1
2
27 CH4
CS 2
20 OSC
PGND 3
26 PGND
CLK 3
19 ISET2
CSEL
4
25 NC
SDI 4
VLOGIC 5
EN_VSYNC 6
VDC 7
EXPOSED
THERMAL PAD
18 ISET1
17 COMP
16 OVP
15 PWM_SET/PLL
SDO
CS
CLK
SDI
5
6
7
8
24 OSC
23 ISET2
22 ISET1
21 COMP
8
9
10
11
12
13
14
VLOGIC
9
20 OVP
EN_VSYNC 10
19 PWM_SET/PLL
Pin Descriptions
VDC 11
VIN 12
EN 13
AGND 14
18
17
16
15
PGND
CS
SLEW
GD
TQFN SOIC
PIN NAME
PIN TYPE
PIN DESCRIPTION
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
SDO
CS
CLK
SDI
VLOGIC
EN_VSYNC
VDC
VIN
EN
AGND
GD
SLEW
CS
PGND
PWM_SET/PLL
I
I
I
I
S
I
S
S
I
S
O
I
I
S
I
Serial data output to next driver
Chip select
Serial clock
Serial data input
Internal 2.5V Digital Bias Regulator. Needs Decoupling Capacitor added to ground
Frame synchronization enable. Ties high to VDC for enable V SYNC function. PWM_SET/PLL also needs to be
configured with an RC network. Pin can be tied to VDC or VLOGIC to enable function
Internal 5V Analog Bias Regulator. Needs Decoupling Capacitor added to ground
Main Power Input. Range: 9V to 32V
LED Driver Enable. Whole chip will shut down when low
Analog Ground
External Boost FET gate control
Boost Regulation Switching Slew Rate control
External Boost FET current sense input
Boost FET gate driver power ground and ground reference for CS pin
For direct PWM mode, tie this pin high to VDC. For other non-VSYNC modes, connect to a resistor to set the
dimming frequency. If the VSYNC function is enabled, connect this pin to the PLL loop filter network.
16
17
18
20
21
22
OVP
COMP
ISET1
I
I
I
Overvoltage Protection Input as well as Output Voltage feedback pin
Boost compensation
Resistor connection for setting LED current. 28.7k ? = 100mA
3
FN7953.0
April 23, 2012
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